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H.264视频编解码低延迟解决方案

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发表于 2018-5-25 17:29:15 | 显示全部楼层 |阅读模式
银亿电子以逻辑语言为基础编写的H.264视频编解码,以IP核的形式,在FPGA器件上运行,基于FPGA的解决方案使用FPGA为核心器件,实现H.264编解码的IP核,此解决方案为纯硬件的解决方案,启动时间可以忽略,编解码延迟为固定的延迟,在一定的优化情况下,延迟为所有解决方案里最小值地。具体特点为:1.支持各种分辨率;2.支持各种帧率;3.编解码延迟低于60ms;4.占用FPGA资源小;5.定制性强.
银亿电子开发的H.264视频编解码解决方案广泛应用于低带宽下、超低延时的星载/机载/弹载/车载视频数据链方面,受到广泛用户一致认可。

合作方式:1.卖IP core   2.卖图像处理板  3.卖H.264原码
有需要的可联系:13720751754(同微信)


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 楼主| 发表于 2018-6-22 10:38:55 | 显示全部楼层
总有同学希望看到用图中的测试方法来测试编解码的延时,放一张图给大家看一下,1080P 60fps,sdi摄像头输入,通过sdi分配器分出两路,一路直接进入显示器,另一路经过编码,rtp传输,然后解码后显示,左右画面的差距为大约20ms,和真实画面的延迟大约为100ms(延迟主要出现在sdi摄像头和分配器上),这种方式看似简单,实际误差极大,实在是不推荐使用!

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 楼主| 发表于 2018-6-25 12:04:52 | 显示全部楼层
H.264视频编解码低延迟xilinx Zynq系列FPGA解决方案资源占比详图如下:

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 楼主| 发表于 2018-7-10 12:48:45 | 显示全部楼层
本帖最后由 银亿电子 于 2018-7-10 12:50 编辑

H.264视频编解码纯FPGA低延迟解决方案演示DEMO.

点击以下文字观看。
H.264视频编解码低延迟解决方案配合自组网电台
H.264视频编解码低延迟解决方案多路输入输出
H.264视频编解码FPGA解决方案原理讲解
H.264视频编解码FPGA解决方案DEMO

 楼主| 发表于 2018-8-7 08:53:39 | 显示全部楼层
本帖最后由 银亿电子 于 2018-8-7 08:55 编辑

目前技术延时已经达到1帧之内!

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