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Intel Ivy Bridge 里的graphic core

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发表于 2011-9-24 02:00:23 | 显示全部楼层 |阅读模式




Intel engineers primarily focused on the following key features:

  • New 22 nm manufacturing process with Tri-Gate Transistors that should reduce heat dissipation;
  • Ivy Bridge core will deliver higher performance and support DirectX 11;
  • It will acquire integrated hardware random numbers generator and OS protection against Escalation of Privilege attacks;
  • New approach to heat dissipation: configurable TDP;
  • Improved memory controller supporting high-speed and low-voltage memory;
  • Additional overclocking functionality.


重点看看这张图



可以研究的有
Thread generation Block ( Geometry front end )
VF, VS, HS, Tessellator? , DS, GS, Stream-Out, Clip/ Setup

Processing block
L1$,  EUs,3D/media sampler, Data port,  Tex$

Common Data Block
Rasrerizer/ Depth , L3$, Pixel/Media Pixel Ops, Render$ Depth$

Accelerator block

Codex and Media, and Displays.


Ring bus, LLC, L3$


抛砖引玉一下,个人分析可以研究几个问题。


1, ring bus 上的 system agent 干什么的, LLC 如果是shared L3, 为什么会有4个partition?


2 ,Thread generation Block 如何设计, thread dispatch unit 输出什么?


3, L3 与ring bus的互联以及cache coherency 方案?


欢迎大牛各抒己见,对自己熟悉的概念请不吝赐教~




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头像被屏蔽
发表于 2011-9-24 05:27:00 | 显示全部楼层
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发表于 2011-9-24 10:05:39 | 显示全部楼层
zenny_chen 发表于 2011-9-24 05:27
首先偶再提供两个网页,描述得更详细些:
http://insidehpc.com/2011/09/15/deep-inside-intels-ivy-bridge ...

这个gpu core在die上会占多大面积呢,如果要和off-the-shelf的gpu竞争?

thread dispatch unit 输出? 字面理解,就是Issue一个warp的threads交给那16个EUs吧。
发表于 2011-9-24 10:21:33 | 显示全部楼层
maxiaohan 发表于 2011-9-24 10:05
这个gpu core在die上会占多大面积呢,如果要和off-the-shelf的gpu竞争?

thread dispatch unit 输出? 字 ...

还有,这gpu core有必要装个L3吗。。。是为了aa?

ivy bridge的竞争对手, trinity, 似乎没看过有用L3。
头像被屏蔽
发表于 2011-9-24 12:45:39 | 显示全部楼层
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发表于 2018-10-17 15:43:22 | 显示全部楼层
好东西啊?多谢这样的好东西
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